Kryptographischer Coprozessor für Server
Autor: | Hans Gregor Molter |
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EAN: | 9783639054378 |
eBook Format: | |
Sprache: | Deutsch |
Produktart: | eBook |
Veröffentlichungsdatum: | 22.08.2008 |
Untertitel: | Effiziente und flexible Multi-Core-Architektur für Server als System-on-a-Chip |
Kategorie: | |
Schlagworte: | Codesign Coprozessor Ecclesiastes Elliptische-Kurven-Kryptographie FPGA Mehrkern RSA Server Systems on Chip |
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Kryptographie ist heutzutage zentraler Bestandteil in modernen Rechensystemen. Besonders in heterogenen Client-Server-Systemen werden spezielle Anforderungen an die kryptographischen Komponenten gestellt: Effizienz und Flexibilität. Effizienz für eine schnelle Verarbeitung der Anfragen mit einem Hauptaugenmerk auf dem Datendurchsatz, weniger auf der Latenz. Flexibilität neue kryptographische Protokolle leicht zu implementieren oder die bestehenden leicht zu modifizieren. Dieses Buch stellt den Entwurf und die Implementierung eines kryptographischen Coprozessors mit einer Mehrkern-Architektur vor. Der Coprozessor implementiert RSA und Elliptische-Kurven-Kryptographie (ECC) als eine System-on-a-Chip (SoC) Lösung auf einem Field-Programmable-Gate-Array (FPGA). Neben der Erklärung der mathematischen Grundlagen, den kryptographischen Protokollen und den Entwurfskriterien, wird das Hardware-Software-Codesign auf einer Mehrkern-Architektur mit verschiedenen Prozessorentypen motiviert.
Hans Gregor Molter, Dipl.-Inform: Studium der Informatik mit dem Schwerpunktfach technische Informatik an der Technischen Universität Darmstadt, 2007. Wissenschaftlicher Mitarbeiter am Institut Integrierte Schaltungen und Systeme, TU Darmstadt. Forschungsschwerpunkte: Sicherheit in eingebetteten Systemen, Berechenbarkeitsmodelle für FPGAs.
Hans Gregor Molter, Dipl.-Inform: Studium der Informatik mit dem Schwerpunktfach technische Informatik an der Technischen Universität Darmstadt, 2007. Wissenschaftlicher Mitarbeiter am Institut Integrierte Schaltungen und Systeme, TU Darmstadt. Forschungsschwerpunkte: Sicherheit in eingebetteten Systemen, Berechenbarkeitsmodelle für FPGAs.